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ホーム > 記事サポート > 2010年 > ICデザイン・コンテスト 特設ページ > ICデザイン・コンテスト 開催概要


下記要綱にてICデザイン・コンテストを開催します.ふるってご応募ください.

開催概要

募集期間

2010年8月10日~2010年11月10日
本コンテストの応募受付は終了いたしました

お送りいただくもの

以下の4点のプリントアウトをお送りください.
  1. 回路図エディタ NS-Toolsで作画した回路図
  2. NS-Toolsによるシミュレーション結果
  3. レポート(最大5ページ)
  4. 連絡先(氏名,年齢,職業,住所,メール・アドレス)
注1:LayoutEditorによるレイアウト・データはお送りいただかなくても結構です.
注2:電子メールでの応募は受け付けません.必ず上記4点のプリントアウトを郵便または宅急便でお送りください.
本コンテストの応募受付は終了いたしました

送り先

〒170-8461
東京都豊島区巣鴨1-14-2
CQ出版社 トランジスタ技術編集部
ICコンテスト係
本コンテストの応募受付は終了いたしました

審査員

森本 浩之氏,トランジスタ技術編集部

審査日

2010年12月20日(予定)

賞:オリジナルICの試作サンプル 1個

ご応募いただいたオリジナル回路を実際のICに仕上げ,ご希望の文字(型名またはお名前)をパッケージにマーキングいたします.入賞者には,LayoutEditorを使ってレイアウト・データ(GDSファイル形式)を作成していただき,編集部と調整したのち,実際のICの製作工程に進みます.試作ラインに投入できるGDSファイルが完成するまでサポートします.


写真 入賞者にはオリジナルICを製作してプレゼント!

協力

九州工業大学
佐賀エレクトロニックス(株)

●入賞作品は,九州工業大学のIC製造ラインのプロセス技術の改善を目的に,モニタ回路として利用させていただきます.

設計条件

回路データ

  • アナログ回路,ディジタル回路のどちらでもOKです
  • 動作速度は10MHz程度(アナログは1MHz程度)を上限とします
  • 電源電圧範囲は3~5Vとします(パワーオン・リセットなどは除く)
  • 合計素子数(トランジスタ,抵抗,容量)は最大100個までとします

レイアウト・データ

  • 端子数は電源,グラウンドを含めて最大8端子です
  • 電源とグラウンドのピン機能は固定です
  • パッドの位置はすべて固定です.パッドとIOセルは下記サイトからダウンロードした配布データを使用してください.
    http://www.analogist.co.jp/TG/IO.gds
  • 垂直,水平方向以外のパターンは禁止します
  • 九州工業大学のレイアウト・デザイン・ルールを守ってください.ルール違反の内容によっては試作投入できません.

免責

  • 提出物に関する著作権,特許,版権などの権利行使を行えません
  • 提出物に関して,提出先に機密保持義務を主張することはできません
  • コンテストを通して実試作したサンプルに対して,製造者側に品質保証,納期保証を求めることはできません
  • 書籍,雑誌以外の手段を通じて入手したモデル・パラメータやデザイン・ルールなどの製造者情報は開示者の許可なく第三者へ開示することはできません

ツール類の入手先

コンテストに応募する際に利用するソフトウェア類の入手先

●回路図エディタ&回路シミュレータ(ns-tools_130.exe)のダウンロード先
http://www.nanodesign.co.jp/products/products003.html

●SPICEモデル(KIT_CMS_CMOS2U_20091023.lzh)のダウンロード先
九州工業大学 マイクロ総合技術センター
http://www.cms.kyutech.ac.jp/param/

入賞者が利用するソフトウェア類の入手先

●レイアウト・エディタ(LayoutEditorJP.zip)のダウンロード先
筆者ホームページ トランジスタ技術 特設ページ
http://www.analogist.co.jp/TG/tg.html

●レイアウト検証ツール(ICV20100624.zip)のダウンロード先
筆者ホームページ トランジスタ技術 特設ページ
http://www.analogist.co.jp/TG/tg.html

●レイアウト用定義ファイル
筆者ホームページ トランジスタ技術 特設ページ
http://www.analogist.co.jp/TG/tg.html
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